Thèse soutenue

Optimisation par synthèse architecturale des méthodes de partitionnement temporel pour les circuits reconfigurables
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Auteur / Autrice : Ting Liu
Direction : Serge Weber
Type : Thèse de doctorat
Discipline(s) : Instrumentation et Micro-Électronique
Date : Soutenance le 13/05/2008
Etablissement(s) : Nancy 1
Ecole(s) doctorale(s) : IAEM - Ecole Doctorale Informatique, Automatique, Électronique - Électrotechnique, Mathématiques
Partenaire(s) de recherche : Laboratoire : Laboratoire d’Instrumentation Electronique de Nancy
Jury : Examinateurs / Examinatrices : Serge Weber, Fabrice Monteiro, Camel Tanougast
Rapporteurs / Rapporteuses : Elbey Bourennane, Jean-Philippe Diguet

Résumé

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Les travaux de recherche présentés se situent dans le contexte des méthodologies d’aide à l’implémentation d’algorithmes graphe flot de données sur architectures reconfigurables dynamiquement de type RSoC (Reconfigurable System on Chip) à base de technologie FPGA. La stratégie visée consiste à mettre en œuvre une approche de conception basée simultanément sur la reconfiguration dynamique (RD) et la synthèse architecturale (SA) en vue d’atteindre la meilleur Adéquation Algorithme Architecture (A3). La méthodologie consiste à identifier et extraire les parties d’une application décrite sous forme d’un GFD afin de les implanter soit par partie successivement reconfigurées (PT), soit par la SA ou bien en combinant les deux méthodes. Pour développer notre solution dans un but d’optimisation et de juste compromis entre les deux approches RD et SA, nous avons défini un paramètre permettant une évaluation du degré inter-partition de mise en œuvre d’unités fonctionnelles partagées. Afin de valider la stratégie méthodologique proposée, nous présentons les résultats de l’application de notre approche sur deux applications temps réel. Une analyse comparative en terme de résultats d’implémentation illustre l’intérêt et la capacité d’optimisation de cette méthode pour l’implémentation en reconfiguration dynamique d’applications complexes sur RSoC.